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Verilog HDL & VHDLテストベンチ記述の初歩 : 論理回路の検証で用いるHDL文法とノウハウ

安岡貴志著. -- CQ出版, 2010. -- (デザインウェーブムック). <BB01541993>
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Verilog HDL & VHDLテストベンチ記述の初歩 : 論理回路の検証で用いるHDL文法とノウハウ

安岡貴志著. -- CQ出版, 2010. -- (デザインウェーブムック). <BB01541993>
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No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 コメント 返却予定日 予約
0001 富山(射水) 研究室 549.05||Y66||Ve 0100708957 研究室 0件
No. 0001
巻号
所蔵館 富山(射水)
配置場所 研究室
請求記号 549.05||Y66||Ve
資料ID 0100708957
状態 研究室
コメント
返却予定日
予約 0件
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書誌詳細

標題および責任表示 Verilog HDL & VHDLテストベンチ記述の初歩 : 論理回路の検証で用いるHDL文法とノウハウ / 安岡貴志著
Verilog HDL & VHDLテスト ベンチ キジュツ ノ ショホ : ロンリ カイロ ノ ケンショウ デ モチイル HDLブンポウ ト ノウハウ
出版・頒布事項 東京 : CQ出版 , 2010.10
形態事項 239p : 挿図 ; 24cm
巻号情報
ISBN 9784789831086
書誌構造リンク デザインウェーブムック||デザイン ウェーブ ムック <BB00137123>//a
その他の標題 奥付タイトル:Verilog HDL & VHDLテストベンチ記述の初歩
Verilog HDL & VHDLテスト ベンチ キジュツ ノ ショホ
その他の標題 異なりアクセスタイトル:テストベンチ : Verilog HDL & VHDL : 記述の初歩 : 論理回路の検証で用いるHDL文法とノウハウ
テスト ベンチ : Verilog HDL & VHDL : テスト ベンチ キジュツ ノ ショホ : ロンリ カイロ ノ ケンショウ デ モチイル HDLブンポウ ト ノウハウ
学情ID BB06984388
本文言語コード 日本語
著者標目リンク 安岡, 貴志
ヤスオカ, タカシ <NC:DA17055266>
分類標目 電子工学 NDC8:549.05
分類標目 電子工学 NDC9:549.05
分類標目 電子工学 NDC9:549.7
件名標目等 電子工学 -- 雑誌||デンシコウガク -- ザッシ
件名標目等 集積回路||シュウセキカイロ
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